Datganiad Preifatrwydd: Mae eich preifatrwydd yn bwysig iawn i ni. Mae ein cwmni'n addo peidio â datgelu eich gwybodaeth bersonol i unrhyw expany heb eich caniatâd penodol.
Model Rhif: NSO4GU3AB
Cludiant: Ocean,Air,Express,Land
Math o Dalu: L/C,T/T,D/A
Incoterm: FOB,EXW,CIF
4GB 1600MHz 240-pin DDR3 Udimm
Hanes Adolygu
Revision No. |
History |
Draft Date |
Remark |
1.0 |
Initial Release |
Apr. 2022 |
|
Tabl Gwybodaeth Archebu
Model |
Density |
Speed |
Organization |
Component Composition |
NS04GU3AB |
4GB |
1600MHz |
512Mx64bit |
DDR3 256Mx8 *16 |
Disgrifiadau
Mae Hengstar heb ei ryfderu DDR3 SDRAM DIMMS (Modiwlau Cof Mewn-lein Deuol Dau Dir DRAM DRAM DRAM DARMANS) yn fodiwlau cof gweithredu cyflym, cyflymder cyflym sy'n defnyddio dyfeisiau SDRAM DDR3. Mae NS04GU3AB yn 512m x 64-bit dau reng 4GB DDR3-1600 CL11 1.5V SDRAM Cynnyrch DIMM heb ei ryfderus, yn seiliedig ar un ar bymtheg ar bymtheg 256m x 8 cydran FBGA 8-did. Mae'r SPD wedi'i raglennu i amseriad Latency DDR3-1600 safonol JEDEC o 11-11-11 yn 1.5V. Mae pob DIMM 240-pin yn defnyddio bysedd cyswllt aur. Mae'r SDRAM UNBUFERED DIMM wedi'i fwriadu i'w ddefnyddio fel prif gof wrth ei osod mewn systemau fel cyfrifiaduron personol a gweithfannau.
Nodweddion
Cyflenwad pŵer: VDD = 1.5V (1.425V i 1.575V)
VDDQ = 1.5V (1.425V i 1.575V)
800MHz FCK ar gyfer 1600MB/eiliad/pin
8 Banc Mewnol Annibynnol
Latency Cas Programmable: 11, 10, 9, 8, 7, 6
Latency Ychwanegol Programmable: 0, Cl - 2, neu Cl - 1 Cloc
8-did cyn-net
Hyd Burst: 8 (rhyngddalennog heb unrhyw derfyn, yn ddilyniannol gyda chyfeiriad cychwynnol “000” yn unig), 4 gyda TCCD = 4 nad yw'n caniatáu darllen nac ysgrifennu di -dor [naill ai ar y hedfan gan ddefnyddio A12 neu MRS]
Strobe Data Gwahaniaethol Bi-Cyfeiriol
Graddnodi internal (hunan); Hunan -raddnodi mewnol trwy pin zq (RZQ: 240 ohm ± 1%)
ar derfynu marw gan ddefnyddio pin ODT
AVerage Prefyn cyfnod 7.8US yn is na TCase 85 ° C, 3.9US ar 85 ° C <tcase <95 ° C.
Ailosodiad ailosod
Cryfder gyrru allbwn data-addasadwy
Topoleg fly-by
PCB: uchder 1.18 ”(30mm)
Rohs yn cydymffurfio ac yn rhydd o halogen
Paramedrau Amseru Allweddol
MT/s |
tRCD(ns) |
tRP(ns) |
tRC(ns) |
CL-tRCD-tRP |
DDR3-1600 |
13.125 |
13.125 |
48.125 |
2011/11/11 |
Tabl Cyfeiriad
Configuration |
Refresh count |
Row address |
Device bank address |
Device configuration |
Column Address |
Module rank address |
4GB |
8K |
32K A[14:0] |
8 BA[2:0] |
2Gb (256 Meg x 8) |
1K A[9:0] |
2 S#[1:0] |
Disgrifiadau pin
Symbol |
Type |
Description |
Ax |
Input |
Address inputs: Provide the row address for ACTIVE commands, and the column |
BAx |
Input |
Bank address inputs: Define the device bank to which an ACTIVE, READ, WRITE, or |
CKx, |
Input |
Clock: Differential clock inputs. All control, command, and address input signals are |
CKEx |
Input |
Clock enable: Enables (registered HIGH) and disables (registered LOW) internal circuitry |
DMx |
Input |
Data mask (x8 devices only): DM is an input mask signal for write data. Input data is |
ODTx |
Input |
On-die termination: Enables (registered HIGH) and disables (registered LOW) |
Par_In |
Input |
Parity input: Parity bit for Ax, RAS#, CAS#, and WE#. |
RAS#, |
Input |
Command inputs: RAS#, CAS#, and WE# (along with S#) define the command being |
RESET# |
Input |
Reset: RESET# is an active LOW asychronous input that is connected to each DRAM and |
Sx# |
Input |
Chip select: Enables (registered LOW) and disables (registered HIGH) the command |
SAx |
Input |
Serial address inputs: Used to configure the temperature sensor/SPD EEPROM address |
SCL |
Input |
Serial |
CBx |
I/O |
Check bits: Used for system error detection and correction. |
DQx |
I/O |
Data input/output: Bidirectional data bus. |
DQSx, |
I/O |
Data strobe: Differential data strobes. Output with read data; edge-aligned with read data; |
SDA |
I/O |
Serial |
TDQSx, |
Output |
Redundant data strobe (x8 devices only): TDQS is enabled/disabled via the LOAD |
Err_Out# |
Output (open |
Parity error output: Parity error found on the command and address bus. |
EVENT# |
Output (open |
Temperature event: The EVENT# pin is asserted by the temperature sensor when critical |
VDD |
Supply |
Power supply: 1.35V (1.283–1.45V) backward-compatible to 1.5V (1.425–1.575V). The |
VDDSPD |
Supply |
Temperature sensor/SPD EEPROM power supply: 3.0–3.6V. |
VREFCA |
Supply |
Reference voltage: Control, command, and address VDD/2. |
VREFDQ |
Supply |
Reference voltage: DQ, DM VDD/2. |
VSS |
Supply |
Ground. |
VTT |
Supply |
Termination voltage: Used for control, command, and address VDD/2. |
NC |
– |
No connect: These pins are not connected on the module. |
NF |
– |
No function: These pins are connected within the module, but provide no functionality. |
Nodiadau : Mae'r tabl Disgrifiad PIN isod yn rhestr gynhwysfawr o'r holl binnau posib ar gyfer pob modiwl DDR3. Gall yr holl binnau a restrir peidio â chael eich cefnogi ar y modiwl hwn. Gweler Aseiniadau PIN am wybodaeth sy'n benodol i'r modiwl hwn.
Diagram bloc swyddogaethol
Modiwl 4GB, 512MX64 (2Rank o x8)
Dimensiynau Modiwl
Golygfa flaen
Golygfa flaen
Nodiadau:
1. Mae pob dimensiwn mewn milimetrau (modfedd); Max/min neu nodweddiadol (teip) lle nodir.
2.Tolerance ar bob dimensiwn ± 0.15mm oni nodir yn wahanol.
3. Mae'r diagram dimensiwn ar gyfer cyfeirio yn unig.
Categorïau Cynnyrch : Ategolion modiwl smart diwydiannol
Datganiad Preifatrwydd: Mae eich preifatrwydd yn bwysig iawn i ni. Mae ein cwmni'n addo peidio â datgelu eich gwybodaeth bersonol i unrhyw expany heb eich caniatâd penodol.
Llenwch fwy o wybodaeth fel y gall hynny gysylltu â chi yn gyflymach
Datganiad Preifatrwydd: Mae eich preifatrwydd yn bwysig iawn i ni. Mae ein cwmni'n addo peidio â datgelu eich gwybodaeth bersonol i unrhyw expany heb eich caniatâd penodol.